รายละเอียดสินค้า:
|
|
สถานที่กำเนิด: | ต้นฉบับ |
---|---|
ชื่อแบรนด์: | original |
ได้รับการรับรอง: | ISO9001:2015standard |
หมายเลขรุ่น: | MT61K256M32JE-14-A |
การชำระเงิน:
|
|
จำนวนสั่งซื้อขั้นต่ำ: | 10 ชิ้น |
ราคา: | 12.74-14.28 USD/PCS |
รายละเอียดการบรรจุ: | มาตรฐาน |
เวลาการส่งมอบ: | 1-3 วันทำการ |
เงื่อนไขการชำระเงิน: | T/T, Western Union, Paypal |
สามารถในการผลิต: | 10000 ชิ้น / เดือน |
ข้อมูลรายละเอียด |
|||
บรรจุภัณฑ์: | ถาด | สไตล์การติดตั้ง: | SMD/SMT |
---|---|---|---|
แพ็คเกจ / เคส: | FBGA-180 | แรงดันไฟจ่าย: | 1.3095 V-1.3905 V |
องค์กร: | 256 ม. x 32 | FPQ: | 1260 |
แสงสูง: | MT61K256M32JE-14-A 8 กิกะไบต์หน่วยความจำแฟลช emmc,8 กิกะไบต์หน่วยความจำแฟลช emmc 256MX32,dram controller IC GDDR6 8 กรัม |
รายละเอียดสินค้า
MT61K256M32JE-14: DRAM ดั้งเดิม GDDR6 8G 256MX32 FBGA การจัดเก็บข้อมูลหน่วยความจำ
คุณสมบัติ
• VDD = VDDQ = 1.35V ±3%, 1.25V ±3% และ 1.20V –2%/+3%
• VPP = 1.8V –3%/+6%
• อัตราข้อมูล: 12 Gb/s, 14 Gb/s, 16 Gb/s
• 2 ช่องแยกอิสระ (x16)
• การกำหนดค่าโหมด x16/x8 และ 2-channel/pseudo channel (PC) ที่รีเซ็ต
• อินเทอร์เฟซแบบปลายเดี่ยวต่อช่องสัญญาณสำหรับคำสั่ง/ที่อยู่ (CA) และข้อมูล
• อินพุตนาฬิกาดิฟเฟอเรนเชียล CK_t/CK_c สำหรับ CA ต่อ 2 ช่อง
• หนึ่งอินพุตนาฬิกาดิฟเฟอเรนเชียล WCK_t/WCK_c ต่อช่องสัญญาณสำหรับข้อมูล (DQ, DBI_n, EDC)
• คำสั่ง/ที่อยู่อัตราข้อมูลสองเท่า (DDR) (CK)
• ข้อมูล Quad data rate (QDR) และ double data rate (DDR) (WCK) ขึ้นอยู่กับความถี่ในการทำงาน
• สถาปัตยกรรมการดึงข้อมูลล่วงหน้า 16n พร้อม 256 บิตต่อการเข้าถึงแบบอ่านหรือเขียนอาร์เรย์
• ธนาคารภายใน 16 แห่ง
• 4 กลุ่มธนาคารสำหรับ tCCDL = 3tCK และ 4tCK
• เวลาแฝงในการอ่านที่ตั้งโปรแกรมได้
• เวลาในการตอบสนองของ WRITE ที่ตั้งโปรแกรมได้
• เขียนฟังก์ชัน data mask ผ่าน CA bus ที่มีความละเอียดระดับ single และ double byte
• การผกผันของบัสข้อมูล (DBI) และการผกผันของบัส CA (CABI)
• อินพุต/เอาต์พุต PLL
• การฝึกบัส CA: การตรวจสอบอินพุตของ CA ผ่านสัญญาณ DQ/ DBI_n/EDC
• การฝึกนาฬิกา WCK2CK พร้อมข้อมูลเฟสผ่านสัญญาณ EDC
• การฝึกอบรมการอ่านและเขียนข้อมูลผ่านการอ่าน FIFO (ความลึก = 6)
• อ่าน/เขียนความสมบูรณ์ของการรับส่งข้อมูลที่ปลอดภัยโดยการตรวจสอบความซ้ำซ้อนแบบวนซ้ำ
• เวลาแฝง CRC READ ที่ตั้งโปรแกรมได้
• เวลาแฝง CRC WRITE ที่ตั้งโปรแกรมได้
• รูปแบบการถือ EDC ที่ตั้งโปรแกรมได้สำหรับ CDR
• โหมด RDQS บนหมุด EDC
ดราม่า | |
เป็นไปตามมาตรฐาน: | รายละเอียด |
SGRAM - GDDR6 | |
SMD/SMT | |
FBGA-180 | |
32 บิต | |
256 ม. x 32 | |
8 Gbit | |
1.75 GHz | |
1.3905 V | |
1.3095 V | |
0 C | |
+ 95 C | |
MT61K | |
ถาด | |
ยี่ห้อ: | ต้นฉบับในสต็อก |
ไวต่อความชื้น: | ใช่ |
ประเภทสินค้า: | ดราม่า |
โรงงานแพ็คจำนวน: | 1260 |
หมวดหมู่ย่อย: | หน่วยความจำและการจัดเก็บข้อมูล |
หน่วยน้ำหนัก: | 0.194430 ออนซ์ |
ป้อนข้อความของคุณ